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Intel a effectué hier une présentation de Centerton, un SoC Atom dédié aux microserveurs dont l'existence avait été révélée en fin d'année dernière.

Ce SoC, fabriqué en 32nm intègre pour rappel deux cores avec gestion de l'hyperthreading, un contrôleur mémoire revu (mais toujours simple canal) et la gestion de la virtualisation, le tout dans un TDP de 5.7 et 8.1W en fonction des modèles.


Le modèle > 6W à été présenté hier dans un concept de microserveur, un "node" complet intégrant le SOC, 4 Go de mémoire, un contrôleur SATA et un contrôleur GbE ne consommant que 8.95W (mesuré en courant continu). Des microserveurs basés sur ces nodes sont actuellement en préparation chez de nombreux partenaires d'Intel (Dell, Hitachi, HP, NEC, Tyan, Quanta et Supermicro). Le lancement, prévu à l'origine pour le second trimestre à cependant été repoussé au second semestre 2012. Notons également sur la roadmap la présence d'un successeur en 22nm, annoncé pour 2013 et dont on ne connait que le nom de code, Avoton.

Par le biais de son forum , Nvidia a publié quelques informations sur le support du PCI Express 3.0 par ses GeForce 600 sur la plateforme Intel X79. En effet, les pilotes publiques fournis par Nvidia n'activent pas le PCI Express 3.0 sur la plateforme haut de gamme d'Intel, bridant alors les GeForce 600 au mode PCI Express 2.0. En cause, la validation de la plateforme plus longue a réaliser que prévue.

Aujourd'hui Nvidia confirme bel et bien un problème indiquant que les cartes mères et les processeurs créent une variabilité dans les timings des signaux trop importante, et que de facto, seul le mode PCI Express 2.0 sera activé et supporté officiellement par le constructeur dans ses pilotes à l'avenir. Une limitation qui, rappelons-le, ne concerne que la plateforme X79 d'Intel en LGA2011. Les plateformes Ivy Bridge en PCI Express 3.0 (par exemple avec le chipset Z77) ne sont pas concernées par ce problème.

Pour les utilisateurs de ces configurations (GeForce 600, Intel X79, SandyBridge-E), Nvidia propose tout de même un patch (téléchargeable ici ) qui permet de forcer manuellement le mode de fonctionnement PCI Express 3.0 (l'outil modifie en réalité une clef de la base de registre, un redémarrage est nécéssaire pour l'activer). Le patch est réversible en ajoutant le paramètre "-revert" en ligne de commande.

Si nous avions noté dans notre test d'Ivy Bridge que ces derniers proposaient de meilleures performances théoriques que la plateforme X79/SNB-E, nous avions noté en pratique un impact extrêmement mesuré par le gain de bande passante obtenu via le PCI Express 3.0. La question de la raison de l'incompatibilité reste cependant ouverte, les pilotes d'AMD activant pour rappel le PCI Express 3.0 automatiquement sur la plateforme Intel X79 avec les Radeon HD 7000.

Intel profite de l'ISC (International Supercomputing Conference) pour annoncer une nouvelle marque, Xeon Phi, qui accueillera les produits dérivés de son architecture MIC (Many Integrated Cores). Le premier produit devrait être disponible fin 2012, il sera basé sur la puce au nom de code Knights Corner dont on entend parler depuis 2010, étant elle-même dérivée de l'arlésienne Larrabee dont il était question depuis... 2007 !

Ce coprocesseur Intel Xeon Phi intégrera plus de 50 cœurs x86 et leurs unités SIMD 512 bits gravés en 22nm Tri-Gate, et il prendra place sur une carte au format PCIe au côté d'un minimum de 8 Go de GDDR5. La performance annoncée de 1 TeraFLOPS sous DGEMM l'an passé a été confirmée à l'ICS sous Linpack (Rmax).


Intel met pour rappel en avant la flexibilité de son architecture, due à l'utilisation d'un cœur x86 généraliste (dérivé d'un Pentium P54C) pour piloter son unité SIMD, même s'il faudra attendre de voir la qualité des outils en pratique.

L'université du Texas devrait mettre en ligne en 2013 le premier supercalculateur architecturé autour de Xeon Phi. Il sera basé sur des milliers de Xeon E5 8 cœurs et de Xeon Phi, fournissant des puissances de calcul respectives de 2 petaFLOPS et 8 petaFLOPS. Intel compte atteindre l'exaFLOPS pour un supercalculateur d'ici 2018, soit l'équivalent d'un millions des actuels Xeon Phi.

LSI, qui a racheté SandForce en octobre 2011, vient d'annoncer  que le codage AES 256 bits des contrôleurs SandForce SF-2000 n'était pas fonctionnel et que le moteur AES-XTS intégré au contrôleur se limitait à l'heure actuelle à l'AES-128. Le constructeur travaillerait sur une mise à jour du firmware mais également du hardware afin de rendre l'AES-256 fonctionnel.

Le codage AES-128 est bien entendu déjà suffisant pour bon nombres d'utilisations, mais certains SSD à base de SandForce SF-2000 étaient vendus en mettant en avant le codage AES-256 censé être géré par la puce. Pour rappel pour activer un tel codage des données sur le SSD il faut activer un mot de passe disque dans le bios du PC.

Intel a publié une mise à jour des spécifications  de son Intel SSD 520, s'attribuant au passage cette découverte, et tout acheteur d'un Intel SSD 520 avant le 1er juillet peut contacter le support d'ici le 1er octobre pour un retour et un remboursement au prix d'achat (cf. ce message ).

De son côté Kingston mettait en avant le codage AES-256 sur ces SSD-Now V+200 et KC100. Le constructeur indique  qu'il travaille activement avec LSI pour que les prochains SSD produits dans ces gammes disposent de l'AES-256. Les utilisateurs qui ont besoin de ce codage sont invités à contacter le service technique de Kingston afin de mettre en place un échange avec ces nouvelles versions lorsqu'elles seront disponibles.