Actualités informatiques du 05-09-2001
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Micron et la DDR333
Micron a indiqué qu'il allait faire la démonstration de différentes plate-formes DDR333 lors des VIA Technology Forum (du 4 au 5 Septembre à Taipei, le 7 à Tokyo, le 11 à Pékin et le 13 à Munich). Ces plate-formes utiliseront un chipset Micron ... qui ne verra jamais le jour dans le commerce, puisqu'il est uniquement destiné à faire la démonstration de la DDR333.
A titre de rappel, la DDR333 utilise en fait des puces de DDR-SDRAM cadencées à 166 MHz qui seront utilisées sur des barrettes de PC2700. Plusieurs chipsets devraient les supporter d'ici à la fin de l'année : SiS645, VIA P4X333 ou encore ALi ALLADiN P4. Comme vous pouvez le remarquer, il s'agit uniquement de chipsets Pentium 4 : il faut dire que ce processeur est le seul à disposer d'un bus lui permettant d'exploiter le surplus de bande passante apporté par la DDR333.
NVIDIA Titanium : les fréquences
Voici les fréquences (GPU / DDR-SDRAM) des 3 cartes de la gamme Titanium que NVIDIA devrait annoncer dans les semaines qui viennent :
- GeForce2 Ti : 250 / 200 MHz
- GeForce3 Ti 200 : 175 / 200 MHz
- GeForce3 Ti 500 : 240 / 260 MHz
Comme vous pouvez le voir, le GeForce2 Ti est entre le GeForce2 Pro (200/200) et le GeForce2 Ultra (250/230). Le GeForce3 Ti 200 est en quelque sorte un GeForce3 (200/230) underclocké, alors que le Ti 500 est un GeForce3 overclocké. Il est toutefois à noter qu'en sus des différences en terme de fréquences, les GeForce3 Ti 200 et 500 pourraient êtres dotées de nouvelles fonctionnalités par rapport à l'actuel GeForce3. Vivement l'annonce !
Kyro II Ultra et Kyro III en retard ?
Selon les dires de x-bit labs , le Kyro II Ultra (STG4800) tout comme le Kyro III (STG5500) seraient en retard. Ainsi, le Kyro II Ultra, dont la sortie était prévue pour cette rentrée, ne pourrait finalement pas sortir. Raison officielle ? Selon STM, un tel produit n’aurait que peu d’intérêt étant donné que le Kyro II se vends bien. Quant au Kyro III, qui est à titre de rappel un chip gravé en 0.13 Micron, cadencé à 250 MHz et disposant de 4 pixel pipeline et du T&L, il est retardé. En effet, alors qu’il était initialement prévu pour fin 2001, il devrait arriver début 2002. Esperons pour STM qu’il n’y aura pas de retard supplémentaire ...
