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PCI Express 5.0 pour 2019, débit doublé

Publié le 30/08/2017 à 17:39 par Marc Prieur

Lors de la conférence Hot Chips 2017, le PCI-SIG a donné quelques informations concernant la version 5.0 du PCI Express à Tom's Hardware . Si la version 4 a subit 2 ans de retard et ne sera finalisée qu'en fin d'année, le PCI-SIG vise une transition rapide vers la 5 qui est prévue en 2019 !

Le débit viser va encore doubler pour atteindre 32 GT/s, ce qui permettra avec un encodage 128b/130b d'atteindre quasiment 4 Go/s pour chaque ligne dans chaque direction, soit 64 Go/s en x16. Il faudra sûrement en contrepartie faire des concessions sur la longueur des pistes possible, sauf à utiliser des puces pour resynchroniser le signal.

Reste à voir quand tout ceci arrivera en pratique dans nos machines !

 
 

PCIe 4.0 fin 2017, le 5.0 à l'étude

Publié le 13/06/2017 à 10:36 par Marc Prieur

Un an après la révision 0.7 des spécifications PCI Express 4.0, la version 0.9 est à son tour en cours de finalisation. Les membres de l'organisation PCI-SIG sont ainsi appelé à effectuer la revue des spécifications avant le 7 août prochain, avec en ligne de mire une version finale avant la fin de l'année soit avec deux ans de retard.

Le PCI Express 4.0 double le débit du 3.0 pour atteindre 16 GT/s, toujours avec un codage 128b/130b soit quasiment 2 Go/s pour chaque ligne dans chaque direction. Ce gain se fera via la fréquence, en contrepartie les connexions utilisables sans puces pour resynchroniser le signal seront plus courtes.

Pour rappel, alors que le PCI-SIG pensait initialement que cette version 4.0 serait la dernière utilisant des pistes en cuivre, une version 5.0 a été annoncée il y a un an. Ses spécifications 0.3 sont actuellement revues par les membres. Si le rythme est le même que pour la version 4.0 on peut s'attendre à une version finale d'ici 2020/2021, le débit visé n'étant pas encore public.

PCIe 4 .0 (encore) en finalisation, 5.0 ensuite

Publié le 30/06/2016 à 23:39 par Marc Prieur

Le PCI Express 4.0 continue d'être mis au point par l'organisme PCI-SIG malgré de nombreux retards. EETimes  nous donne quelques nouvelles, ainsi la version 0.7 des spécifications initialement prévue pour fin 2015 n'est pas encore approuvée, il faudra a priori attendre encore un mois avant que ce soit le cas. Il faudra encore au moins une version 0.x avant la version définitive 1.0 qui n'arrivera pas avant 2017.

Le consensus prenant plus de temps que prévu il semble que certains industriels s'impatientent, au point de lancer des produits basés sur cette révision 0.7 qu'ils estiment assez avancée. Tant qu'il s'agit de produits très spécialisés ou l'interopérabilité n'est pas la priorité, tels qu'une puce Mellanox 100G Infiniband qui a fait l'objet d'une démonstration, pourquoi pas.

Rappelons que cette version doublera le débit pour atteindre 16 GT/s avec un codage identique de 128b/130b, soit quasiment 2 Go/s pour chaque ligne dans chaque direction. Ce gain se fait uniquement via la fréquence, la contrepartie étant que les connexions utilisables sans resynchroniseur de signal sera plus courte.

Alors que le PCI-SIG pensait lorsqu'il a commencé à travailler sur la version 4.0 qu'il s'agirait de sa dernière interconnexion utilisant des pistes en cuivre, il semble que finalement une version 5.0 verra ensuite le jour. Beaucoup de questions sont encore en suspens, ne serait-ce que le débit (le double soit 32 GT/s, ou 25 GT/s ?) ou encore la rétrocompatibilité.

PCIe Gen4 pour 2017, dernière version en cuivre ?

Publié le 25/06/2015 à 13:34 par Marc Prieur

EETimes  nous donne des nouvelles du PCI Express Gen4, qui avait déjà été retardé à fin 2016 alors qu'il était initialement prévu pour 2014 ou 2015. Si les ingénieurs de l'organisme PCI-SIG, en charge de la norme, font déjà tourner le PCIe Gen4 à sa vitesse de 16 GT/s en laboratoire la finalisation devrait encore prendre du retard.

Il est désormais question d'une version 0.7 des spécifications pour la fin de l'année, alors qu'il est désormais possible que la version finale ne voit pas le jour avant 2017. Il faut dire que pour arriver à un tel débit, qui correspond à quasiment 2 Go /s dans chaque sens pour chaque ligne, les ingénieurs doivent pousser les connexions en cuivre dans leurs dernier retranchements.

La longueur des connexions utilisables sans resynchroniseur de signal devrait d'ailleurs être réduite, la limite n'a pas encore été définie mais elle pourrait être d'environ 18 cm là où on pouvait atteindre au moins 30 cm jusqu'alors, ce qui devrait complexifier la mise au point des cartes mères les plus haut de gamme où des ports PCIe gérés par le CPU sont situés à l'extrémité de la carte.

Un nouveau connecteur serait également à l'ordre du jour, mais il est prévu pour être retro-compatible avec les normes précédentes. Pour la génération suivante, il faudra probablement passer à des liens optiques.

Le PCI Express 4.0, en retard, pour fin 2016

Publié le 17/04/2015 à 09:38 par Marc Prieur / source: soa

Lorsqu'il a été annoncé fin 2011, le PCI Express 4.0 devait être finalisé en 2014 ou 2015. Sur la FAQ dédiée à cette nouvelle norme , l'organisme PCI-SIG indique désormais que cela ne devrait être le cas que fin 2016. Ce changement semble dater du début d'année, il était question de fin 2015 auparavant, un changement datant de 2012 qui laissait déjà augurer d'un petit retard par rapport à ce qui était initialement prévu.

Pour rappel cette nouvelle version a pour but de doubler les débits par rapport au PCIe 3.0, avec 16 Gigatransferts par seconde ce qui avec le codage 128b/130b permet quasiment d'atteindre 2 Go /s par ligne dans chaque direction. En x16 on atteindrait donc 32 Go/s, contre 4 Go/s pour le désormais antique PCIe 1.0 qui a débarqué dans nos machines en 2004. Intel devait commencer à supporter le PCIe 4.0 à compter de Skylake-E qui devrait justement arriver autour de fin 2016 également, reste à voir si le retard dans les spécifications finales permettra à Intel de maintenir ce support.

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